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面试等最新动态
面试等最新动态
匿名用户
嵌入式的面试
问的都是宏观的问题，没有啥具体的问题，
面试官与个人的能力边界不太一致，但最终还是被录用了。
所以感觉是着急招人完成指标
面试官与个人的能力边界不太一致，但最终还是被录用了。
所以感觉是着急招人完成指标
面试结果： 确定通过
面试难度： 很容易
面试感受： 不好
匿名用户
Java的面试
视屏面试：面试主要是说了一下我所做过的项目，围绕项目谈了我所用到的技术，框架，面试过程相对比较顺利，
又谈了一些生活方面的，比如出差问题，有无女朋友，对留西安的想法，家里的意见等等。
又谈了一些生活方面的，比如出差问题，有无女朋友，对留西安的想法，家里的意见等等。
面试结果： 感觉靠谱
面试难度： 一般
面试感受： 一般
匿名用户
电子/半导体的面试
一般面试都会过，现在正缺人，面试了8个8个人都过了。所以基本不用担心，基本上都是没问题的。
面试结果： 确定通过
面试难度： 很容易
面试感受： 很好
两年前
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匿名用户
FPGA开发的面试
先是笔试题目，主要就是一些关于soc的，所以架构啊，总线啊，一些常见的英文缩写得懂，特别是GPU。
用D触发器实现二分频。
用D触发器实现二分频。
面试官的问题：
问用D触发器实现二分频。
答q输出经过反相重新输入回输入端。
面试结果： 确定通过
面试难度： 困难
面试感受： 很好
匿名用户
IC验证工程师的面试
首先是宣讲会，主要靠西电实习的或者入职的师兄来拉人，拉亲近感，然后是第一次笔试，主要还是一些eetop上的常见ic前端一百题。第二次笔试是具体的项目分组，根据不同的组，比如GPU组，芯片组，SOC组，模拟组等等设置题目，根据相应题目答题情况和专业，简历最后选择分配到的组。
如何用D触发器搭一个二分频电路？
...查看全文
如何用D触发器搭一个二分频电路？
面试官的问题：
问如何用D触发器搭一个二分频电路？
答由于不方便画图，在此口述——方法1：将D触发器的输出端dout通过反相器接到输入端din,这样没经过一个clk上升沿，假设第一次din为1，那么第一个clk输出为1，经过反相后为0，下一个clk上升沿来时，din就是前面的0了，输出此时变为0。相当于verilog里的 #T（分频的时钟源周期），clk=~clk。
面试结果： 确定通过
面试难度： 一般
面试感受： 一般
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