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SDRAM的问题，并且问题难度有所上升，又被问了读写效能的问题（这里注意，如果前面有问题没答上来，最好面试结束后去了解一下，以免被再次问到）我自然是没答上来，SDRAM设计难点主要在什么地方？刷新请求到来时，读数据处于突发模式时，数据未突发完，此时来了刷新请求，如果等待一次突发完成以后可能导致刷新请求不能得到及时的响应，这时该怎么办（一次突发如果中途被打断，会导致后面需要读写的数据丢失，所以一般等待突发结束在跳出当前状态）？然后又问了FPGA的内部组成？LE中查找表的实现原理？分布式RAM与块RAM有什么区别？查找表与触发器是怎么构成分布式RAM的？全局时钟域与局部时钟的区别？IOB的主要组成部分？建立时间不满足与保持时间不满足是由什么原因产生的，怎么解决，具体怎么做？

一面 一面的话是技术面，主要是自我介绍之后，聊简历内容，介绍项目比赛情况，项目难点，目前的商业化的和实验室的差距在哪里，一些专业知识的回答技术主管面，自我介绍，聊简历内容，介绍项目比赛情况，项目难点，画项目框图，问了GTH接口的速率，然后卷积模块内容，以及DSP+SRIO口的内容，讲一下论文内容，创新点是什么，职场规划，对公司的看法，以及日常生活，课外生活，对老师的看法